mirror of
https://gitlab.com/freepascal.org/fpc/source.git
synced 2025-06-17 15:38:19 +02:00
* basic framework for integrated arm assembler
git-svn-id: trunk@1061 -
This commit is contained in:
florian
parent
35ac5f133e
commit
14fca113bf
7
.gitattributes
vendored
7
.gitattributes
vendored
@ -38,6 +38,12 @@ compiler/arm/aoptcpu.pas svneol=native#text/plain
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compiler/arm/aoptcpub.pas svneol=native#text/plain
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compiler/arm/aoptcpub.pas svneol=native#text/plain
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compiler/arm/aoptcpuc.pas svneol=native#text/plain
|
compiler/arm/aoptcpuc.pas svneol=native#text/plain
|
||||||
compiler/arm/aoptcpud.pas svneol=native#text/plain
|
compiler/arm/aoptcpud.pas svneol=native#text/plain
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||||||
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compiler/arm/armatt.inc svneol=native#text/plain
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||||||
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compiler/arm/armatts.inc svneol=native#text/plain
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compiler/arm/armnop.inc svneol=native#text/plain
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||||||
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compiler/arm/armop.inc svneol=native#text/plain
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||||||
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compiler/arm/armtab.inc svneol=native#text/plain
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compiler/arm/cgcpu.pas svneol=native#text/plain
|
compiler/arm/cgcpu.pas svneol=native#text/plain
|
||||||
compiler/arm/cpubase.pas svneol=native#text/plain
|
compiler/arm/cpubase.pas svneol=native#text/plain
|
||||||
compiler/arm/cpuinfo.pas svneol=native#text/plain
|
compiler/arm/cpuinfo.pas svneol=native#text/plain
|
||||||
@ -439,6 +445,7 @@ compiler/utils/fpimpdef.pp svneol=native#text/plain
|
|||||||
compiler/utils/fppkg.pp svneol=native#text/plain
|
compiler/utils/fppkg.pp svneol=native#text/plain
|
||||||
compiler/utils/gppc386.pp svneol=native#text/plain
|
compiler/utils/gppc386.pp svneol=native#text/plain
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compiler/utils/mk68kreg.pp svneol=native#text/plain
|
compiler/utils/mk68kreg.pp svneol=native#text/plain
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|
compiler/utils/mkarmins.pp svneol=native#text/plain
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||||||
compiler/utils/mkarmreg.pp svneol=native#text/plain
|
compiler/utils/mkarmreg.pp svneol=native#text/plain
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compiler/utils/mkmpsreg.pp svneol=native#text/plain
|
compiler/utils/mkmpsreg.pp svneol=native#text/plain
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compiler/utils/mkppcreg.pp svneol=native#text/plain
|
compiler/utils/mkppcreg.pp svneol=native#text/plain
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File diff suppressed because it is too large
Load Diff
63
compiler/arm/armatt.inc
Normal file
63
compiler/arm/armatt.inc
Normal file
@ -0,0 +1,63 @@
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{ don't edit, this file is generated from armins.dat }
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'adc',
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'add',
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'and',
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'b',
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'bic',
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'bl',
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'bx',
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'cdp',
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'cmn',
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'cmp',
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'dcb',
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'dcd',
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'dcw',
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'dq',
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'dt',
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'eor',
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'ldc',
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'ldmda',
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'ldmdb',
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'ldmea',
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'ldmed',
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'ldmfa',
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'ldmfd',
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'ldmia',
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'ldmib',
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'ldr',
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|
'ldrh',
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'ldrsb',
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'ldrsh',
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'mcr',
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'mla',
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'mov',
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'mrc',
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'mrs',
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'msr',
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'mul',
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'mvn',
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'orr',
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'rsb',
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'rsc',
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'sbc',
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'smlal',
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'smull',
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'stmda',
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'stmdb',
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'stmea',
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'stmed',
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'stmfa',
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|
'stmfd',
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'stmia',
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'stmib',
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'str',
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|
'strh',
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'sub',
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'swi',
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'swp',
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'teq',
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'tst',
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'umlal',
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||||||
|
'umull'
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);
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63
compiler/arm/armatts.inc
Normal file
63
compiler/arm/armatts.inc
Normal file
@ -0,0 +1,63 @@
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{ don't edit, this file is generated from armins.dat }
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(
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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attsufNONE,
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|
attsufNONE
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);
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295
compiler/arm/armins.dat
Normal file
295
compiler/arm/armins.dat
Normal file
@ -0,0 +1,295 @@
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|
;
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|
; Table of assembler instructions for Free Pascal
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|
; adapted from Netwide Assembler by Florian Klaempfl
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;
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|
; The Netwide Assembler is copyright (C) 1996 Simon Tatham and
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|
; Julian Hall. All rights reserved. The software is
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|
; redistributable under the licence given in the file "Licence"
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|
; distributed in the NASM archive.
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;
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|
; Format of file: all four fields must be present on every functional
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; line. Hence `void' for no-operand instructions, and `\0' for such
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; as EQU. If the last three fields are all `ignore', no action is
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; taken except to register the opcode as being present.
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;
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;
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; 'ignore' means no instruc
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|
; 'void' means instruc with zero operands
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;
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|
; Third field has a first byte indicating how to
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; put together the bits, and then some codes
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|
; that may be used at will (see assemble.c)
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;
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; \1 - 24 bit pc-rel offset [B, BL]
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; \2 - 24 bit imm value [SWI]
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; \3 - 3 byte code [BX]
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;
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; \4 - reg,reg,reg [AND,EOR,SUB,RSB,ADD,ADC,SBC,RSC,ORR,BIC]
|
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|
; \5 - reg,reg,reg,<shift>reg [-"-]
|
||||||
|
; \6 - reg,reg,reg,<shift>#imm [-"-]
|
||||||
|
; \7 - reg,reg,#imm [-"-]
|
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|
;
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|
; \x8 - reg,reg [MOV,MVN]
|
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|
; \x9 - reg,reg,<shift>reg [-"-]
|
||||||
|
; \xA - reg,reg,<shift>#imm [-"-]
|
||||||
|
; \xB - reg,#imm [-"-]
|
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|
;
|
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|
; \xC - reg,reg [CMP,CMN,TEQ,TST]
|
||||||
|
; \xD - reg,reg,<shift>reg [-"-]
|
||||||
|
; \xE - reg,reg,<shift>#imm [-"-]
|
||||||
|
; \xF - reg,#imm [-"-]
|
||||||
|
;
|
||||||
|
|
||||||
|
[ADCcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\xA0 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\xA0 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\xA0 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\xA0 ARM7
|
||||||
|
|
||||||
|
[ADDcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\x80 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\x80 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\x80 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\x80 ARM7
|
||||||
|
|
||||||
|
[ANDcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\x00 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\x00 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\x00 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\x00 ARM7
|
||||||
|
|
||||||
|
[Bcc]
|
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|
mem32 \1\x0A ARM7
|
||||||
|
imm32 \1\x0A ARM7
|
||||||
|
|
||||||
|
[BICcc]
|
||||||
|
reg32,reg32,reg32 \4\x1\xC0 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x1\xC0 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x1\xC0 ARM7
|
||||||
|
reg32,reg32,imm \7\x3\xC0 ARM7
|
||||||
|
|
||||||
|
[BLcc]
|
||||||
|
mem32 \1\x0B ARM7
|
||||||
|
imm32 \1\x0B ARM7
|
||||||
|
|
||||||
|
|
||||||
|
[BXcc]
|
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|
reg32 \3\x01\x2F\xFF\x10 ARM7
|
||||||
|
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|
[CDP]
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|
reg8,reg8 \300\1\x10\101 8086
|
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|
[CMNcc]
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||||||
|
reg32,reg32 \xC\x1\x60 ARM7
|
||||||
|
reg32,reg32,reg32 \xD\x1\x60 ARM7
|
||||||
|
reg32,reg32,imm \xE\x1\x60 ARM7
|
||||||
|
reg32,imm \xF\x3\x60 ARM7
|
||||||
|
|
||||||
|
[CMPcc]
|
||||||
|
reg32,reg32 \xC\x1\x40 ARM7
|
||||||
|
reg32,reg32,reg32 \xD\x1\x40 ARM7
|
||||||
|
reg32,reg32,imm \xE\x1\x40 ARM7
|
||||||
|
reg32,imm \xF\x3\x40 ARM7
|
||||||
|
|
||||||
|
[DCB]
|
||||||
|
ignore ignore ignore
|
||||||
|
|
||||||
|
[DCD]
|
||||||
|
ignore ignore ignore
|
||||||
|
|
||||||
|
[DCW]
|
||||||
|
ignore ignore ignore
|
||||||
|
|
||||||
|
[DQ]
|
||||||
|
ignore ignore ignore
|
||||||
|
|
||||||
|
[DT]
|
||||||
|
ignore ignore ignore
|
||||||
|
|
||||||
|
[EORcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\x20 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\x20 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\x20 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\x20 ARM7
|
||||||
|
|
||||||
|
[LDC]
|
||||||
|
reg32,reg32 \321\300\1\x11\101 ARM7
|
||||||
|
|
||||||
|
[LDMDAcc]
|
||||||
|
reg32,reglist \x26\x81 ARM7
|
||||||
|
|
||||||
|
[LDMDBcc]
|
||||||
|
reg32,reglist \x26\x91 ARM7
|
||||||
|
|
||||||
|
[LDMEAcc]
|
||||||
|
reg32,reglist \x26\x91 ARM7
|
||||||
|
|
||||||
|
[LDMEDcc]
|
||||||
|
reg32,reglist \x26\x99 ARM7
|
||||||
|
|
||||||
|
[LDMFAcc]
|
||||||
|
reg32,reglist \x26\x81 ARM7
|
||||||
|
|
||||||
|
[LDMFDcc]
|
||||||
|
reg32,reglist \x26\x89 ARM7
|
||||||
|
|
||||||
|
[LDMIAcc]
|
||||||
|
reg32,reglist \x26\x89 ARM7
|
||||||
|
|
||||||
|
[LDMIBcc]
|
||||||
|
reg32,reglist \x26\x99 ARM7
|
||||||
|
|
||||||
|
[LDRcc]
|
||||||
|
reg32,imm32 \x17\x05\x10 ARM7
|
||||||
|
reg32,reg32 \x18\x04\x10 ARM7
|
||||||
|
reg32,reg32,imm32 \x19\x04\x10 ARM7
|
||||||
|
reg32,reg32,reg32 \x20\x06\x10 ARM7
|
||||||
|
reg32,reg32,reg32,imm32 \x21\x06\x10 ARM7
|
||||||
|
|
||||||
|
[LDRHcc]
|
||||||
|
reg32,imm32 \x22\x50\xB0 ARM7
|
||||||
|
reg32,reg32 \x23\x50\xB0 ARM7
|
||||||
|
reg32,reg32,imm32 \x24\x50\xB0 ARM7
|
||||||
|
reg32,reg32,reg32 \x25\x10\xB0 ARM7
|
||||||
|
|
||||||
|
[LDRSBcc]
|
||||||
|
reg32,imm32 \x22\x50\xD0 ARM7
|
||||||
|
reg32,reg32 \x23\x50\xD0 ARM7
|
||||||
|
reg32,reg32,imm32 \x24\x50\xD0 ARM7
|
||||||
|
reg32,reg32,reg32 \x25\x10\xD0 ARM7
|
||||||
|
|
||||||
|
[LDRSHcc]
|
||||||
|
reg32,imm32 \x22\x50\xF0 ARM7
|
||||||
|
reg32,reg32 \x23\x50\xF0 ARM7
|
||||||
|
reg32,reg32,imm32 \x24\x50\xF0 ARM7
|
||||||
|
reg32,reg32,reg32 \x25\x10\xF0 ARM7
|
||||||
|
|
||||||
|
[MCR]
|
||||||
|
reg32,mem32 \320\301\1\x13\110 8086
|
||||||
|
|
||||||
|
[MLAcc]
|
||||||
|
reg32,reg32,reg32,reg32 \x15\x00\x20\x90 ARM7
|
||||||
|
|
||||||
|
[MOVcc]
|
||||||
|
reg32,reg32 \x8\x1\xA0 ARM7
|
||||||
|
reg32,reg32,reg32 \x9\x1\xA0 ARM7
|
||||||
|
reg32,reg32,imm \xA\x1\xA0 ARM7
|
||||||
|
reg32,imm \xB\x3\xA0 ARM7
|
||||||
|
|
||||||
|
[MRC]
|
||||||
|
reg32,reg32 \321\301\1\x13\110 ARM7
|
||||||
|
|
||||||
|
[MRScc]
|
||||||
|
reg32,reg32 \x10\x01\x0F ARM7
|
||||||
|
|
||||||
|
[MSRcc]
|
||||||
|
reg32,reg32 \x11\x01\x29\xF0 ARM7
|
||||||
|
regf,reg32 \x12\x01\x28\xF0 ARM7
|
||||||
|
regf,imm \x13\x03\x28\xF0 ARM7
|
||||||
|
|
||||||
|
[MULcc]
|
||||||
|
reg32,reg32,reg32 \x14\x00\x00\x90 ARM7
|
||||||
|
|
||||||
|
[MVNcc]
|
||||||
|
reg32,reg32 \x8\x1\xE0 ARM7
|
||||||
|
reg32,reg32,reg32 \x9\x1\xE0 ARM7
|
||||||
|
reg32,reg32,imm \xA\x1\xE0 ARM7
|
||||||
|
reg32,imm \xB\x3\xE0 ARM7
|
||||||
|
|
||||||
|
[ORRcc]
|
||||||
|
reg32,reg32,reg32 \4\x1\x80 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x1\x80 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x1\x80 ARM7
|
||||||
|
reg32,reg32,imm \7\x3\x80 ARM7
|
||||||
|
|
||||||
|
[RSBcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\x60 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\x60 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\x60 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\x60 ARM7
|
||||||
|
|
||||||
|
[RSCcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\xE0 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\xE0 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\xE0 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\xE0 ARM7
|
||||||
|
|
||||||
|
[SBCcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\xC0 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\xC0 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\xC0 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\xC0 ARM7
|
||||||
|
|
||||||
|
[SMLALcc]
|
||||||
|
reg32,reg32,reg32,reg32 \x16\x00\xE0\x90 ARM7
|
||||||
|
|
||||||
|
[SMULLcc]
|
||||||
|
reg32,reg32,reg32,reg32 \x16\x00\xC0\x90 ARM7
|
||||||
|
|
||||||
|
[STMDAcc]
|
||||||
|
reg32,reglist \x26\x80 ARM7
|
||||||
|
|
||||||
|
[STMDBcc]
|
||||||
|
reg32,reglist \x26\x90 ARM7
|
||||||
|
|
||||||
|
[STMEAcc]
|
||||||
|
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|
||||||
|
|
||||||
|
[STMEDcc]
|
||||||
|
reg32,reglist \x26\x80 ARM7
|
||||||
|
|
||||||
|
[STMFAcc]
|
||||||
|
reg32,reglist \x26\x98 ARM7
|
||||||
|
|
||||||
|
[STMFDcc]
|
||||||
|
reg32,reglist \x26\x90 ARM7
|
||||||
|
|
||||||
|
[STMIAcc]
|
||||||
|
reg32,reglist \x26\x88 ARM7
|
||||||
|
|
||||||
|
[STMIBcc]
|
||||||
|
reg32,reglist \x26\x98 ARM7
|
||||||
|
|
||||||
|
[STRcc]
|
||||||
|
reg32,imm32 \x17\x05\x00 ARM7
|
||||||
|
reg32,reg32 \x18\x04\x00 ARM7
|
||||||
|
reg32,reg32,imm32 \x19\x04\x00 ARM7
|
||||||
|
reg32,reg32,reg32 \x20\x06\x00 ARM7
|
||||||
|
reg32,reg32,reg32,imm32 \x21\x06\x00 ARM7
|
||||||
|
|
||||||
|
; A dummy since it is parsed as STR{cond}H
|
||||||
|
[STRHcc]
|
||||||
|
reg32,imm32 \x22\x40\xB0 ARM7
|
||||||
|
reg32,reg32 \x23\x40\xB0 ARM7
|
||||||
|
reg32,reg32,imm32 \x24\x40\xB0 ARM7
|
||||||
|
reg32,reg32,reg32 \x25\x00\xB0 ARM7
|
||||||
|
|
||||||
|
[SUBcc]
|
||||||
|
reg32,reg32,reg32 \4\x0\x40 ARM7
|
||||||
|
reg32,reg32,reg32,reg32 \5\x0\x40 ARM7
|
||||||
|
reg32,reg32,reg32,imm \6\x0\x40 ARM7
|
||||||
|
reg32,reg32,imm \7\x2\x40 ARM7
|
||||||
|
|
||||||
|
[SWIcc]
|
||||||
|
imm \2\x0F 8086
|
||||||
|
|
||||||
|
[SWPcc]
|
||||||
|
reg32,reg32,reg32 \x27\x01\x90 ARM7
|
||||||
|
|
||||||
|
[TEQcc]
|
||||||
|
reg32,reg32 \xC\x1\x20 ARM7
|
||||||
|
reg32,reg32,reg32 \xD\x1\x20 ARM7
|
||||||
|
reg32,reg32,imm \xE\x1\x20 ARM7
|
||||||
|
reg32,imm \xF\x3\x20 ARM7
|
||||||
|
|
||||||
|
[TSTcc]
|
||||||
|
reg32,reg32 \xC\x1\x00 ARM7
|
||||||
|
reg32,reg32,reg32 \xD\x1\x00 ARM7
|
||||||
|
reg32,reg32,imm \xE\x1\x00 ARM7
|
||||||
|
reg32,imm \xF\x3\x00 ARM7
|
||||||
|
|
||||||
|
[UMLALcc]
|
||||||
|
reg32,reg32,reg32,reg32 \x16\x00\xA0\x90 ARM7
|
||||||
|
[UMULLcc]
|
||||||
|
reg32,reg32,reg32,reg32 \x16\x00\x80\x90 ARM7
|
||||||
2
compiler/arm/armnop.inc
Normal file
2
compiler/arm/armnop.inc
Normal file
@ -0,0 +1,2 @@
|
|||||||
|
{ don't edit, this file is generated from armins.dat }
|
||||||
|
132;
|
||||||
63
compiler/arm/armop.inc
Normal file
63
compiler/arm/armop.inc
Normal file
@ -0,0 +1,63 @@
|
|||||||
|
{ don't edit, this file is generated from armins.dat }
|
||||||
|
(
|
||||||
|
A_ADC,
|
||||||
|
A_ADD,
|
||||||
|
A_AND,
|
||||||
|
A_B,
|
||||||
|
A_BIC,
|
||||||
|
A_BL,
|
||||||
|
A_BX,
|
||||||
|
A_CDP,
|
||||||
|
A_CMN,
|
||||||
|
A_CMP,
|
||||||
|
A_DCB,
|
||||||
|
A_DCD,
|
||||||
|
A_DCW,
|
||||||
|
A_DQ,
|
||||||
|
A_DT,
|
||||||
|
A_EOR,
|
||||||
|
A_LDC,
|
||||||
|
A_LDMDA,
|
||||||
|
A_LDMDB,
|
||||||
|
A_LDMEA,
|
||||||
|
A_LDMED,
|
||||||
|
A_LDMFA,
|
||||||
|
A_LDMFD,
|
||||||
|
A_LDMIA,
|
||||||
|
A_LDMIB,
|
||||||
|
A_LDR,
|
||||||
|
A_LDRH,
|
||||||
|
A_LDRSB,
|
||||||
|
A_LDRSH,
|
||||||
|
A_MCR,
|
||||||
|
A_MLA,
|
||||||
|
A_MOV,
|
||||||
|
A_MRC,
|
||||||
|
A_MRS,
|
||||||
|
A_MSR,
|
||||||
|
A_MUL,
|
||||||
|
A_MVN,
|
||||||
|
A_ORR,
|
||||||
|
A_RSB,
|
||||||
|
A_RSC,
|
||||||
|
A_SBC,
|
||||||
|
A_SMLAL,
|
||||||
|
A_SMULL,
|
||||||
|
A_STMDA,
|
||||||
|
A_STMDB,
|
||||||
|
A_STMEA,
|
||||||
|
A_STMED,
|
||||||
|
A_STMFA,
|
||||||
|
A_STMFD,
|
||||||
|
A_STMIA,
|
||||||
|
A_STMIB,
|
||||||
|
A_STR,
|
||||||
|
A_STRH,
|
||||||
|
A_SUB,
|
||||||
|
A_SWI,
|
||||||
|
A_SWP,
|
||||||
|
A_TEQ,
|
||||||
|
A_TST,
|
||||||
|
A_UMLAL,
|
||||||
|
A_UMULL
|
||||||
|
);
|
||||||
927
compiler/arm/armtab.inc
Normal file
927
compiler/arm/armtab.inc
Normal file
@ -0,0 +1,927 @@
|
|||||||
|
{ don't edit, this file is generated from armins.dat }
|
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|
(
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|
(
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opcode : A_ADC;
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code : #4#0#160;
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(
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|
code : #5#0#160;
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flags : if_arm7
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),
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|
(
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|
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|
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|
code : #6#0#160;
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||||||
|
flags : if_arm7
|
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|
),
|
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|
(
|
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|
opcode : A_ADC;
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|
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|
optypes : (ot_reg32,ot_reg32,ot_immediate,);
|
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|
code : #7#2#160;
|
||||||
|
flags : if_arm7
|
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|
),
|
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|
(
|
||||||
|
opcode : A_ADD;
|
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|
ops : 3;
|
||||||
|
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|
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|
code : #4#0#128;
|
||||||
|
flags : if_arm7
|
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|
),
|
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|
(
|
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|
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|
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|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_reg32);
|
||||||
|
code : #5#0#128;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_ADD;
|
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|
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|
||||||
|
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|
||||||
|
code : #6#0#128;
|
||||||
|
flags : if_arm7
|
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|
),
|
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|
(
|
||||||
|
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|
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|
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|
||||||
|
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|
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|
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|
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|
flags : if_arm7
|
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|
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|
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|
(
|
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|
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|
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|
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|
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||||||
|
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|
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|
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|
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|
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|
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|
(
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
),
|
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|
(
|
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|
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|
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|
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|
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|
(
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|
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|
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|
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|
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|
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|
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|
(
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|
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|
(
|
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|
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|
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|
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|
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|
||||||
|
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|
||||||
|
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|
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),
|
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|
(
|
||||||
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|
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|
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|
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|
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|
||||||
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),
|
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|
(
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|
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||||||
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|
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|
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|
(
|
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|
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(
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|
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(
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|
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(
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(
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(
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(
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(
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(
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(
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(
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(
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(
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(
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|
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(
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|
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opcode : A_SBC;
|
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|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_immediate);
|
||||||
|
code : #6#0#192;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
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|
(
|
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|
opcode : A_SBC;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_immediate,);
|
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|
code : #7#2#192;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_SMLAL;
|
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|
ops : 4;
|
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optypes : (ot_reg32,ot_reg32,ot_reg32,ot_reg32);
|
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|
code : #22#0#224#144;
|
||||||
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flags : if_arm7
|
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),
|
||||||
|
(
|
||||||
|
opcode : A_SMULL;
|
||||||
|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_reg32);
|
||||||
|
code : #22#0#192#144;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
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opcode : A_STMDA;
|
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|
||||||
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optypes : (ot_reg32,ot_reglist,ot_none,);
|
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|
code : #38#128;
|
||||||
|
flags : if_arm7
|
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|
),
|
||||||
|
(
|
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opcode : A_STMDB;
|
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ops : 2;
|
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optypes : (ot_reg32,ot_reglist,ot_none,);
|
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|
code : #38#144;
|
||||||
|
flags : if_arm7
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|
),
|
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|
(
|
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opcode : A_STMEA;
|
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|
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optypes : (ot_reg32,ot_reglist,ot_none,);
|
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|
code : #38#136;
|
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|
flags : if_arm7
|
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|
),
|
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|
(
|
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opcode : A_STMED;
|
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ops : 2;
|
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optypes : (ot_reg32,ot_reglist,ot_none,);
|
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|
code : #38#128;
|
||||||
|
flags : if_arm7
|
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|
),
|
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|
(
|
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opcode : A_STMFA;
|
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|
ops : 2;
|
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|
optypes : (ot_reg32,ot_reglist,ot_none,);
|
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|
code : #38#152;
|
||||||
|
flags : if_arm7
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|
),
|
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|
(
|
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opcode : A_STMFD;
|
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|
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|
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optypes : (ot_reg32,ot_reglist,ot_none,);
|
||||||
|
code : #38#144;
|
||||||
|
flags : if_arm7
|
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|
),
|
||||||
|
(
|
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|
opcode : A_STMIA;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_reglist,ot_none,);
|
||||||
|
code : #38#136;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
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|
opcode : A_STMIB;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_reglist,ot_none,);
|
||||||
|
code : #38#152;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STR;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_immediate or ot_bits32,ot_none,);
|
||||||
|
code : #23#5#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STR;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_none,);
|
||||||
|
code : #24#4#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STR;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_immediate or ot_bits32,);
|
||||||
|
code : #25#4#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STR;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,);
|
||||||
|
code : #32#6#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STR;
|
||||||
|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_immediate or ot_bits32);
|
||||||
|
code : #33#6#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STRH;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_immediate or ot_bits32,ot_none,);
|
||||||
|
code : #34#64#176;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STRH;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_none,);
|
||||||
|
code : #35#64#176;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STRH;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_immediate or ot_bits32,);
|
||||||
|
code : #36#64#176;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_STRH;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,);
|
||||||
|
code : #37#0#176;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_SUB;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,);
|
||||||
|
code : #4#0#64;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_SUB;
|
||||||
|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_reg32);
|
||||||
|
code : #5#0#64;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_SUB;
|
||||||
|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_immediate);
|
||||||
|
code : #6#0#64;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_SUB;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_immediate,);
|
||||||
|
code : #7#2#64;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_SWI;
|
||||||
|
ops : 1;
|
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|
optypes : (ot_immediate,ot_none,ot_none,);
|
||||||
|
code : #2#15;
|
||||||
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flags : if_8086
|
||||||
|
),
|
||||||
|
(
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opcode : A_SWP;
|
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ops : 3;
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optypes : (ot_reg32,ot_reg32,ot_reg32,);
|
||||||
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code : #39#1#144;
|
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flags : if_arm7
|
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),
|
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|
(
|
||||||
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opcode : A_TEQ;
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ops : 2;
|
||||||
|
optypes : (ot_reg32 or ot_signed,ot_reg32,ot_none,);
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||||||
|
code : #12#1#32;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_TEQ;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32 or ot_signed,ot_reg32,);
|
||||||
|
code : #13#1#32;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_TEQ;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_immediate or ot_signed,);
|
||||||
|
code : #14#1#32;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_TEQ;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_immediate,ot_none,);
|
||||||
|
code : #15#3#32;
|
||||||
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flags : if_arm7
|
||||||
|
),
|
||||||
|
(
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||||||
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opcode : A_TST;
|
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ops : 2;
|
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optypes : (ot_reg32 or ot_signed,ot_reg32,ot_none,);
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code : #12#1#0;
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||||||
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flags : if_arm7
|
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|
),
|
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|
(
|
||||||
|
opcode : A_TST;
|
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|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32 or ot_signed,ot_reg32,);
|
||||||
|
code : #13#1#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_TST;
|
||||||
|
ops : 3;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_immediate or ot_signed,);
|
||||||
|
code : #14#1#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_TST;
|
||||||
|
ops : 2;
|
||||||
|
optypes : (ot_reg32,ot_immediate,ot_none,);
|
||||||
|
code : #15#3#0;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_UMLAL;
|
||||||
|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_reg32);
|
||||||
|
code : #22#0#160#144;
|
||||||
|
flags : if_arm7
|
||||||
|
),
|
||||||
|
(
|
||||||
|
opcode : A_UMULL;
|
||||||
|
ops : 4;
|
||||||
|
optypes : (ot_reg32,ot_reg32,ot_reg32,ot_reg32);
|
||||||
|
code : #22#0#128#144;
|
||||||
|
flags : if_arm7
|
||||||
|
)
|
||||||
|
);
|
||||||
@ -52,6 +52,8 @@ implementation
|
|||||||
{$ifndef NOAGARMGAS}
|
{$ifndef NOAGARMGAS}
|
||||||
,agarmgas
|
,agarmgas
|
||||||
{$endif}
|
{$endif}
|
||||||
|
|
||||||
|
,ogcoff
|
||||||
;
|
;
|
||||||
|
|
||||||
end.
|
end.
|
||||||
|
|||||||
@ -1101,7 +1101,12 @@ const go32v2stub : array[0..2047] of byte=(
|
|||||||
sympos:=datapos;
|
sympos:=datapos;
|
||||||
{ COFF header }
|
{ COFF header }
|
||||||
fillchar(header,sizeof(coffheader),0);
|
fillchar(header,sizeof(coffheader),0);
|
||||||
|
{$ifdef i386}
|
||||||
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|
header.mach:=$14c;
|
||||||
|
{$endif i386}
|
||||||
|
{$ifdef arm}
|
||||||
|
header.mach:=$1c0;
|
||||||
|
{$endif arm}
|
||||||
header.nsects:=nsects;
|
header.nsects:=nsects;
|
||||||
header.sympos:=sympos;
|
header.sympos:=sympos;
|
||||||
header.syms:=symbols.count+initsym;
|
header.syms:=symbols.count+initsym;
|
||||||
@ -1614,7 +1619,12 @@ const go32v2stub : array[0..2047] of byte=(
|
|||||||
Comment(V_Error,'Error reading coff file');
|
Comment(V_Error,'Error reading coff file');
|
||||||
exit;
|
exit;
|
||||||
end;
|
end;
|
||||||
|
{$ifdef i386}
|
||||||
if header.mach<>$14c then
|
if header.mach<>$14c then
|
||||||
|
{$endif i386}
|
||||||
|
{$ifdef arm}
|
||||||
|
if header.mach<>$1c0 then
|
||||||
|
{$endif arm}
|
||||||
begin
|
begin
|
||||||
Comment(V_Error,'Not a coff file');
|
Comment(V_Error,'Not a coff file');
|
||||||
exit;
|
exit;
|
||||||
@ -1756,7 +1766,6 @@ const go32v2stub : array[0..2047] of byte=(
|
|||||||
comment : '';
|
comment : '';
|
||||||
);
|
);
|
||||||
|
|
||||||
const
|
|
||||||
as_i386_pecoff_info : tasminfo =
|
as_i386_pecoff_info : tasminfo =
|
||||||
(
|
(
|
||||||
id : as_i386_pecoff;
|
id : as_i386_pecoff;
|
||||||
@ -1794,9 +1803,26 @@ const go32v2stub : array[0..2047] of byte=(
|
|||||||
);
|
);
|
||||||
|
|
||||||
|
|
||||||
|
as_arm_pecoffwince_info : tasminfo =
|
||||||
|
(
|
||||||
|
id : as_arm_pecoffwince;
|
||||||
|
idtxt : 'PECOFFWINCE';
|
||||||
|
asmbin : '';
|
||||||
|
asmcmd : '';
|
||||||
|
supported_target : system_arm_wince;
|
||||||
|
flags : [af_outputbinary];
|
||||||
|
labelprefix : '.L';
|
||||||
|
comment : '';
|
||||||
|
);
|
||||||
|
|
||||||
initialization
|
initialization
|
||||||
|
{$ifdef i386}
|
||||||
RegisterAssembler(as_i386_coff_info,TCoffAssembler);
|
RegisterAssembler(as_i386_coff_info,TCoffAssembler);
|
||||||
RegisterAssembler(as_i386_pecoff_info,TPECoffAssembler);
|
RegisterAssembler(as_i386_pecoff_info,TPECoffAssembler);
|
||||||
RegisterAssembler(as_i386_pecoffwdosx_info,TPECoffAssembler);
|
RegisterAssembler(as_i386_pecoffwdosx_info,TPECoffAssembler);
|
||||||
RegisterAssembler(as_i386_pecoffwince_info,TPECoffAssembler);
|
RegisterAssembler(as_i386_pecoffwince_info,TPECoffAssembler);
|
||||||
|
{$endif i386}
|
||||||
|
{$ifdef arm}
|
||||||
|
RegisterAssembler(as_arm_pecoffwince_info,TPECoffAssembler);
|
||||||
|
{$endif arm}
|
||||||
end.
|
end.
|
||||||
|
|||||||
@ -40,7 +40,7 @@ unit rabase;
|
|||||||
pasmmodeinfo = ^tasmmodeinfo;
|
pasmmodeinfo = ^tasmmodeinfo;
|
||||||
tasmmodeinfo = record
|
tasmmodeinfo = record
|
||||||
id : tasmmode;
|
id : tasmmode;
|
||||||
idtxt : string[8];
|
idtxt : string[12];
|
||||||
casmreader : tcbaseasmreader;
|
casmreader : tcbaseasmreader;
|
||||||
end;
|
end;
|
||||||
|
|
||||||
|
|||||||
@ -143,6 +143,7 @@ interface
|
|||||||
,as_x86_64_masm
|
,as_x86_64_masm
|
||||||
,as_x86_64_pecoff
|
,as_x86_64_pecoff
|
||||||
,as_i386_pecoffwince
|
,as_i386_pecoffwince
|
||||||
|
,as_arm_pecoffwince
|
||||||
);
|
);
|
||||||
|
|
||||||
tar = (ar_none
|
tar = (ar_none
|
||||||
@ -210,7 +211,7 @@ interface
|
|||||||
pasminfo = ^tasminfo;
|
pasminfo = ^tasminfo;
|
||||||
tasminfo = record
|
tasminfo = record
|
||||||
id : tasm;
|
id : tasm;
|
||||||
idtxt : string[9];
|
idtxt : string[12];
|
||||||
asmbin : string[8];
|
asmbin : string[8];
|
||||||
asmcmd : string[50];
|
asmcmd : string[50];
|
||||||
supported_target : tsystem;
|
supported_target : tsystem;
|
||||||
|
|||||||
430
compiler/utils/mkarmins.pp
Normal file
430
compiler/utils/mkarmins.pp
Normal file
@ -0,0 +1,430 @@
|
|||||||
|
{
|
||||||
|
Copyright (c) 1998-2005 by Peter Vreman and Florian Klaempfl
|
||||||
|
|
||||||
|
Convert i386ins.dat from Nasm to a .inc file for usage with
|
||||||
|
the Free pascal compiler
|
||||||
|
|
||||||
|
See the file COPYING.FPC, included in this distribution,
|
||||||
|
for details about the copyright.
|
||||||
|
|
||||||
|
This program is distributed in the hope that it will be useful,
|
||||||
|
but WITHOUT ANY WARRANTY; without even the implied warranty of
|
||||||
|
MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.
|
||||||
|
|
||||||
|
**********************************************************************}
|
||||||
|
program mkarmins;
|
||||||
|
|
||||||
|
const
|
||||||
|
Version = '0.9';
|
||||||
|
|
||||||
|
var
|
||||||
|
s : string;
|
||||||
|
i : longint;
|
||||||
|
x86_64 : boolean;
|
||||||
|
|
||||||
|
{$ifndef FPC}
|
||||||
|
procedure readln(var t:text;var s:string);
|
||||||
|
var
|
||||||
|
c : char;
|
||||||
|
i : longint;
|
||||||
|
begin
|
||||||
|
c:=#0;
|
||||||
|
i:=0;
|
||||||
|
while (not eof(t)) and (c<>#10) do
|
||||||
|
begin
|
||||||
|
read(t,c);
|
||||||
|
if c<>#10 then
|
||||||
|
begin
|
||||||
|
inc(i);
|
||||||
|
s[i]:=c;
|
||||||
|
end;
|
||||||
|
end;
|
||||||
|
if (i>0) and (s[i]=#13) then
|
||||||
|
dec(i);
|
||||||
|
s[0]:=chr(i);
|
||||||
|
end;
|
||||||
|
{$endif}
|
||||||
|
|
||||||
|
function lower(const s : string) : string;
|
||||||
|
{
|
||||||
|
return lowercased string of s
|
||||||
|
}
|
||||||
|
var
|
||||||
|
i : longint;
|
||||||
|
begin
|
||||||
|
for i:=1 to length(s) do
|
||||||
|
if s[i] in ['A'..'Z'] then
|
||||||
|
lower[i]:=char(byte(s[i])+32)
|
||||||
|
else
|
||||||
|
lower[i]:=s[i];
|
||||||
|
lower[0]:=s[0];
|
||||||
|
end;
|
||||||
|
|
||||||
|
function Replace(var s:string;const s1,s2:string):boolean;
|
||||||
|
var
|
||||||
|
i : longint;
|
||||||
|
begin
|
||||||
|
i:=pos(s1,s);
|
||||||
|
if i>0 then
|
||||||
|
begin
|
||||||
|
Delete(s,i,length(s1));
|
||||||
|
Insert(s2,s,i);
|
||||||
|
Replace:=true;
|
||||||
|
end
|
||||||
|
else
|
||||||
|
Replace:=false;
|
||||||
|
end;
|
||||||
|
|
||||||
|
|
||||||
|
function formatop(s:string):string;
|
||||||
|
const
|
||||||
|
replaces=19;
|
||||||
|
replacetab : array[1..replaces,1..2] of string[32]=(
|
||||||
|
(':',' or ot_colon'),
|
||||||
|
('mem8','mem or ot_bits8'),
|
||||||
|
('mem16','mem or ot_bits16'),
|
||||||
|
('mem32','mem or ot_bits32'),
|
||||||
|
('mem64','mem or ot_bits64'),
|
||||||
|
('mem80','mem or ot_bits80'),
|
||||||
|
('mem','memory'),
|
||||||
|
('memory_offs','mem_offs'),
|
||||||
|
('imm8','imm or ot_bits8'),
|
||||||
|
('imm16','imm or ot_bits16'),
|
||||||
|
('imm32','imm or ot_bits32'),
|
||||||
|
('imm64','imm or ot_bits64'),
|
||||||
|
('imm80','imm or ot_bits80'),
|
||||||
|
('imm','immediate'),
|
||||||
|
('rm8','regmem or ot_bits8'),
|
||||||
|
('rm16','regmem or ot_bits16'),
|
||||||
|
('rm32','regmem or ot_bits32'),
|
||||||
|
('rm64','regmem or ot_bits64'),
|
||||||
|
('rm80','regmem or ot_bits80')
|
||||||
|
);
|
||||||
|
var
|
||||||
|
i : longint;
|
||||||
|
begin
|
||||||
|
for i:=1to replaces do
|
||||||
|
replace(s,replacetab[i,1],replacetab[i,2]);
|
||||||
|
formatop:=s;
|
||||||
|
end;
|
||||||
|
|
||||||
|
|
||||||
|
function readnumber : longint;
|
||||||
|
|
||||||
|
var
|
||||||
|
base : longint;
|
||||||
|
result : longint;
|
||||||
|
|
||||||
|
begin
|
||||||
|
result:=0;
|
||||||
|
if s[i]='\' then
|
||||||
|
begin
|
||||||
|
base:=8;
|
||||||
|
inc(i);
|
||||||
|
if s[i]='x' then
|
||||||
|
begin
|
||||||
|
base:=16;
|
||||||
|
inc(i);
|
||||||
|
end;
|
||||||
|
end
|
||||||
|
else
|
||||||
|
base:=10;
|
||||||
|
s[i]:=upcase(s[i]);
|
||||||
|
while s[i] in ['0'..'9','A'..'F'] do
|
||||||
|
begin
|
||||||
|
case s[i] of
|
||||||
|
'0'..'9':
|
||||||
|
result:=result*base+ord(s[i])-ord('0');
|
||||||
|
|
||||||
|
'A'..'F':
|
||||||
|
result:=result*base+ord(s[i])-ord('A')+10;
|
||||||
|
end;
|
||||||
|
inc(i);
|
||||||
|
end;
|
||||||
|
readnumber:=result;
|
||||||
|
end;
|
||||||
|
|
||||||
|
function tostr(l : longint) : string;
|
||||||
|
|
||||||
|
var
|
||||||
|
hs : string;
|
||||||
|
|
||||||
|
begin
|
||||||
|
str(l,hs);
|
||||||
|
tostr:=hs;
|
||||||
|
end;
|
||||||
|
|
||||||
|
function readstr : string;
|
||||||
|
|
||||||
|
var
|
||||||
|
result : string;
|
||||||
|
|
||||||
|
begin
|
||||||
|
result:='';
|
||||||
|
while (s[i] in ['0'..'9','A'..'Z','a'..'z','_']) and (i<=length(s)) do
|
||||||
|
begin
|
||||||
|
result:=result+s[i];
|
||||||
|
inc(i);
|
||||||
|
end;
|
||||||
|
readstr:=result;
|
||||||
|
end;
|
||||||
|
|
||||||
|
procedure skipspace;
|
||||||
|
|
||||||
|
begin
|
||||||
|
while (s[i] in [' ',#9]) do
|
||||||
|
inc(i);
|
||||||
|
end;
|
||||||
|
|
||||||
|
procedure openinc(var f:text;const fn:string);
|
||||||
|
begin
|
||||||
|
writeln('creating ',fn);
|
||||||
|
assign(f,fn);
|
||||||
|
rewrite(f);
|
||||||
|
writeln(f,'{ don''t edit, this file is generated from armins.dat }');
|
||||||
|
writeln(f,'(');
|
||||||
|
end;
|
||||||
|
|
||||||
|
|
||||||
|
procedure closeinc(var f:text);
|
||||||
|
begin
|
||||||
|
writeln(f);
|
||||||
|
writeln(f,');');
|
||||||
|
close(f);
|
||||||
|
end;
|
||||||
|
|
||||||
|
|
||||||
|
var
|
||||||
|
attsuffix,
|
||||||
|
hs : string;
|
||||||
|
j : longint;
|
||||||
|
firstopcode,
|
||||||
|
first : boolean;
|
||||||
|
maxinfolen,
|
||||||
|
code : byte;
|
||||||
|
insns : longint;
|
||||||
|
attsuffile,propfile,opfile,
|
||||||
|
nopfile,attfile,
|
||||||
|
infile,insfile : text;
|
||||||
|
{ instruction fields }
|
||||||
|
skip : boolean;
|
||||||
|
last,
|
||||||
|
ops : longint;
|
||||||
|
attopcode,
|
||||||
|
opcode,
|
||||||
|
codes,
|
||||||
|
flags : string;
|
||||||
|
optypes : array[1..4] of string;
|
||||||
|
begin
|
||||||
|
writeln('Narm Instruction Table Converter Version ',Version);
|
||||||
|
insns:=0;
|
||||||
|
maxinfolen:=0;
|
||||||
|
{ open dat file }
|
||||||
|
assign(infile,'../arm/armins.dat');
|
||||||
|
{ create inc files }
|
||||||
|
openinc(insfile,'armtab.inc');
|
||||||
|
openinc(opfile,'armop.inc');
|
||||||
|
assign(nopfile,'armnop.inc');
|
||||||
|
openinc(attfile,'armatt.inc');
|
||||||
|
openinc(attsuffile,'armatts.inc');
|
||||||
|
{
|
||||||
|
openinc(intfile,'i386int.inc');
|
||||||
|
openinc(propfile,'i386prop.inc');
|
||||||
|
}
|
||||||
|
rewrite(nopfile);
|
||||||
|
writeln(nopfile,'{ don''t edit, this file is generated from armins.dat }');
|
||||||
|
reset(infile);
|
||||||
|
first:=true;
|
||||||
|
opcode:='';
|
||||||
|
firstopcode:=true;
|
||||||
|
while not(eof(infile)) do
|
||||||
|
begin
|
||||||
|
{ handle comment }
|
||||||
|
readln(infile,s);
|
||||||
|
while (s[1]=' ') do
|
||||||
|
delete(s,1,1);
|
||||||
|
if (s='') or (s[1]=';') then
|
||||||
|
continue;
|
||||||
|
if (s[1]='[') then
|
||||||
|
begin
|
||||||
|
i:=pos(',',s);
|
||||||
|
j:=pos(']',s);
|
||||||
|
if i=0 then
|
||||||
|
begin
|
||||||
|
opcode:='A_'+Copy(s,2,j-2);
|
||||||
|
attopcode:=Copy(s,2,j-2);
|
||||||
|
{ Conditional }
|
||||||
|
if (attopcode[length(attopcode)]='c') and
|
||||||
|
(attopcode[length(attopcode)-1]='c') then
|
||||||
|
begin
|
||||||
|
dec(byte(attopcode[0]),2);
|
||||||
|
dec(byte(opcode[0]),2);
|
||||||
|
end;
|
||||||
|
attsuffix:='attsufNONE';
|
||||||
|
end
|
||||||
|
else
|
||||||
|
begin
|
||||||
|
opcode:='A_'+Copy(s,2,i-2);
|
||||||
|
{ intel conditional }
|
||||||
|
if (opcode[length(attopcode)]='c') and
|
||||||
|
(opcode[length(attopcode)-1]='c') then
|
||||||
|
dec(byte(opcode[0]),2);
|
||||||
|
attopcode:=Copy(s,i+1,j-i-1);
|
||||||
|
{ att Suffix }
|
||||||
|
case attopcode[length(attopcode)] of
|
||||||
|
'X' :
|
||||||
|
begin
|
||||||
|
dec(attopcode[0]);
|
||||||
|
attsuffix:='attsufINT';
|
||||||
|
end;
|
||||||
|
'F' :
|
||||||
|
begin
|
||||||
|
dec(attopcode[0]);
|
||||||
|
attsuffix:='attsufFPU';
|
||||||
|
end;
|
||||||
|
'R' :
|
||||||
|
begin
|
||||||
|
dec(attopcode[0]);
|
||||||
|
attsuffix:='attsufFPUint';
|
||||||
|
end;
|
||||||
|
else
|
||||||
|
attsuffix:='attsufNONE';
|
||||||
|
end;
|
||||||
|
{ att Conditional }
|
||||||
|
if (attopcode[length(attopcode)]='C') and
|
||||||
|
(attopcode[length(attopcode)-1]='C') then
|
||||||
|
dec(byte(attopcode[0]),2);
|
||||||
|
end;
|
||||||
|
attopcode:=Lower(attopcode);
|
||||||
|
if firstopcode then
|
||||||
|
firstopcode:=false
|
||||||
|
else
|
||||||
|
begin
|
||||||
|
writeln(opfile,',');
|
||||||
|
writeln(attfile,',');
|
||||||
|
writeln(attsuffile,',');
|
||||||
|
{ writeln(propfile,','); }
|
||||||
|
end;
|
||||||
|
write(opfile,opcode);
|
||||||
|
write(attfile,'''',attopcode,'''');
|
||||||
|
write(attsuffile,attsuffix);
|
||||||
|
{ read the next line which contains the Change options }
|
||||||
|
{
|
||||||
|
repeat
|
||||||
|
readln(infile,s);
|
||||||
|
until eof(infile) or ((s<>'') and (s[1]<>';'));
|
||||||
|
write(propfile,'(Ch: ',s,')');
|
||||||
|
}
|
||||||
|
continue;
|
||||||
|
end;
|
||||||
|
{ we must have an opcode }
|
||||||
|
if opcode='' then
|
||||||
|
runerror(234);
|
||||||
|
{ clear }
|
||||||
|
ops:=0;
|
||||||
|
optypes[1]:='';
|
||||||
|
optypes[2]:='';
|
||||||
|
optypes[3]:='';
|
||||||
|
optypes[4]:='';
|
||||||
|
codes:='';
|
||||||
|
flags:='';
|
||||||
|
skip:=false;
|
||||||
|
{ ops and optypes }
|
||||||
|
i:=1;
|
||||||
|
repeat
|
||||||
|
hs:=readstr;
|
||||||
|
if (hs='void') or (hs='ignore') then
|
||||||
|
break;
|
||||||
|
inc(ops);
|
||||||
|
optypes[ops]:=optypes[ops]+'ot_'+formatop(hs);
|
||||||
|
{ if s[i]=':' then
|
||||||
|
begin
|
||||||
|
inc(i);
|
||||||
|
optypes[ops]:=optypes[ops]+' or ot_'+formatop(readstr);
|
||||||
|
end;}
|
||||||
|
while s[i]='|' do
|
||||||
|
begin
|
||||||
|
inc(i);
|
||||||
|
optypes[ops]:=optypes[ops]+' or ot_'+formatop(readstr);
|
||||||
|
end;
|
||||||
|
if s[i] in [',',':'] then
|
||||||
|
inc(i)
|
||||||
|
else
|
||||||
|
break;
|
||||||
|
until false;
|
||||||
|
for j:=1 to 3-ops do
|
||||||
|
optypes[3-j+1]:='ot_none';
|
||||||
|
{ codes }
|
||||||
|
skipspace;
|
||||||
|
j:=0;
|
||||||
|
last:=0;
|
||||||
|
if s[i] in ['\','0'..'9'] then
|
||||||
|
begin
|
||||||
|
while not(s[i] in [' ',#9]) do
|
||||||
|
begin
|
||||||
|
code:=readnumber;
|
||||||
|
{ for some codes we want also to change the optypes, but not
|
||||||
|
if the last byte was a 1 then this byte belongs to a direct
|
||||||
|
copy }
|
||||||
|
if last<>1 then
|
||||||
|
begin
|
||||||
|
case code of
|
||||||
|
12,13,14 :
|
||||||
|
optypes[code-11]:=optypes[code-11]+' or ot_signed';
|
||||||
|
end;
|
||||||
|
end;
|
||||||
|
codes:=codes+'#'+tostr(code);
|
||||||
|
last:=code;
|
||||||
|
inc(j);
|
||||||
|
end;
|
||||||
|
end
|
||||||
|
else
|
||||||
|
begin
|
||||||
|
readstr;
|
||||||
|
codes:='#0';
|
||||||
|
end;
|
||||||
|
if j>maxinfolen then
|
||||||
|
maxinfolen:=j;
|
||||||
|
{ flags }
|
||||||
|
skipspace;
|
||||||
|
while not(s[i] in [' ',#9,#13,#10]) and (i<=length(s)) do
|
||||||
|
begin
|
||||||
|
hs:=readstr;
|
||||||
|
if hs<>'ND' then
|
||||||
|
begin
|
||||||
|
if flags<>'' then
|
||||||
|
flags:=flags+' or ';
|
||||||
|
flags:=flags+'if_'+lower(hs);
|
||||||
|
end;
|
||||||
|
if (s[i]=',') and (i<=length(s)) then
|
||||||
|
inc(i)
|
||||||
|
else
|
||||||
|
break;
|
||||||
|
end;
|
||||||
|
{ write instruction }
|
||||||
|
if not skip then
|
||||||
|
begin
|
||||||
|
if not(first) then
|
||||||
|
writeln(insfile,',')
|
||||||
|
else
|
||||||
|
first:=false;
|
||||||
|
writeln(insfile,' (');
|
||||||
|
writeln(insfile,' opcode : ',opcode,';');
|
||||||
|
writeln(insfile,' ops : ',ops,';');
|
||||||
|
writeln(insfile,' optypes : (',optypes[1],',',optypes[2],',',optypes[3],',',optypes[4],');');
|
||||||
|
writeln(insfile,' code : ',codes,';');
|
||||||
|
writeln(insfile,' flags : ',flags);
|
||||||
|
write(insfile,' )');
|
||||||
|
inc(insns);
|
||||||
|
end;
|
||||||
|
end;
|
||||||
|
close(infile);
|
||||||
|
closeinc(insfile);
|
||||||
|
closeinc(attfile);
|
||||||
|
closeinc(attsuffile);
|
||||||
|
closeinc(opfile);
|
||||||
|
writeln(nopfile,insns,';');
|
||||||
|
close(nopfile);
|
||||||
|
{ closeinc(propfile); }
|
||||||
|
writeln(insns,' nodes procesed (maxinfolen=',maxinfolen,')');
|
||||||
|
end.
|
||||||
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